环形谐波振荡器time-to-digital转换器

下面这篇文章介绍了一个简单而且高性能的time-to-digital(TDC)转换器结构。这种结构的优点是它可以采样和保持一个时间间隔,而后过采样存储的大量数据以保证sub-gate的延时分辨率和高度线性化。这种转换器是全数字化的,可综合的RTL代码;它使用时间存储的机理,采用注入多个信号边沿到环形振荡器并追踪它们相关的相位变化。来自FPGA虚拟样机的结果显示极好的噪声抑制效果,该结果是通过采用64倍速率的过采样,在环形振荡器注入精确的0.05倍反相器延时脉冲信号得到的。 详细内容请点击这里

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